國 立 交 通 大 學
電子工程學系 電子研究所 碩士班
碩 士 論 文
使用加入緩衝器之低振幅延遲合併嵌入式演算 法用以降低時鐘網路之功率消耗
On Reducing Clock Network Power Consumption by Low-Swing DME Buffering Technique
研 究 生：林昀達（Yun-Ta Lin）
指導教授： 陳宏明 教授（Prof. Hung-Ming Chen）
使用加入緩衝器之低振幅延遲合併嵌入式演算法用以降低時鐘網路之功率消耗
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