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先進加解密標準演算法硬體電路之實現

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Academic year: 2021

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(1)

國

立

交

通

大

學

電機學院 電子與光電學程

碩

士

論

文

先進加解密標準演算法硬體電路之實現

Table base implementation of AES hardware circuit

研 究 生：郭昌華

指導教授：葉義雄 教授

陳紹基 教授

(2)

先進加解密標準演算法硬體電路之實現

Table base

implementation

of AES hardware circuit

研 究 生：郭昌華 Student：Chang-Hwa Kuo

指導教授：葉義雄 Advisor：Yi-Shiung Yeh

陳紹基 Sau-Gee Chen

國 立 交 通 大 學

電機學院 電子與光電學程

碩 士 論 文

A Thesis

Submitted to College of Electrical and Computer Engineering National Chiao Tung University

in partial Fulfillment of the Requirements for the Degree of

Master of Science in

Electronics and Electro-Optical Engineering January 2007

Hsinchu, Taiwan, Republic of China

數據

Table base implementation of AES hardware circuit

參考文獻

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